Cadence Concept-HDL & Allegro原理图与电路板设计(第2版)
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6.2 元件的布局

布局是一个很复杂的过程,布局的好坏直接影响以后的走线效率。布局工作做得好,以后走线时会节省大量的时间;反之,则不仅布线的时间会大大加长,而且有可能影响板子的性能和指标。比如,数字电路部分元件被放置在模拟区,终端匹配电路被放置到驱动端,这些都对性能和指标有严重的影响,所以布局时要仔细考虑各方面的影响。

在项目管理器窗口单击Layout,打开PCB编辑器文件pcbxxx.brd,包含cpu、ram、daamp1和daamp2区域。

1.重新设置DAAMP模块

(1)选择Set→User Preferences,打开User Preferences Editor对话框,在Categories列表中单击Paths→Library,如图6-2-1所示。

(2)单击Value按钮设置modulepath参量,如图6-2-2所示。

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图6-2-1 Categories列表

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图6-2-2 设置modulepath参量

(3)在modulepath Items窗口,单击Insert图标添加一个新行,如图6-2-3所示。

(4)单击浏览按钮img,定位到User1/ftb/ modules目录,并单击OK按钮,如图6-2-4所示。

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图6-2-3 modulepath Items窗口

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图6-2-4 定位目录

(5)单击OK按钮关闭modulepath Items窗口。

(6)单击OK按钮关闭User Preferences Editor窗口。

2.放置DAAMP模块

(1)放大DAAMP1和DAAMP2区域。

(2)选择Place→Manually,打开Placement窗口,在Placement List选项卡下选择Module instances,如图6-2-5所示。

(3)展开文件夹,单击DAAMP/DAAMP_1,如图6-2-6所示。

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图6-2-5 Placement窗口

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图6-2-6 单击DAAMP/DAAMP_1

(4)一个矩形轮廓随着光标显示出来。在控制窗口输入坐标x 1575 850,模块中元件的位置被确定。元件的布局被定义在DAAMP工程中,如图6-2-7所示。

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图6-2-7 定位daamp1

(5)单击DAAMP/DAAMP_2,如图6-2-8所示,并定位到如下坐标:x 1575 50。

(6)在Placement窗口中单击close按钮。

(7)放大DAAMP区域并在每个模块中观察重新设置后的参考指示符和后缀(_1和_2)。

3.完成DAAMP布局

(1)选择Place→Manually,打开Placement窗口,在Placement List选项卡中选择Components by refdes,如图6-2-9所示。

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图6-2-8 单击DAAMP/DAAMP_2

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图6-2-9 Placement List选项卡设置

(2)在Placement菜单,设置Selection filters选项为Room,并选择Daamp1,如图6-2-10所示。

(3)在右边的区域,选择Components by refdes,如图6-2-11所示,单击Hide按钮。

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图6-2-10 设置Selection filters

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图6-2-11 选择Components by refdes

(4)DAAMP1区域指定地方的一个元件会自动连接到光标上,单击放置这个元件到DAAMP1区域。

(5)第二个DAAMP1元件会连接到光标,放置这个元件到DAAMP1区域。

(6)单击右键在快捷菜单中选择Show,打开Placement窗口。

(7)重复上述操作步骤,放置元件到DAAMP2区域。完成后,单击右键在快捷菜单中选择Done。

(8)使用Edit→Move来调整视图,选择View→Zoom Fit查看全图。

(9)选择File→Save,单击Yes按钮保存设置。

4.放置CPU区域

(1)放大CPU区域,选择Place→Manually。

(2)在Placement菜单,设置Selection filters选项为Room,并将room选择为Cpu,如图6-2-12所示。

(3)在右边的区域,选择Components by refdes并单击Hide按钮,CPU封装连接到光标上。

(4)单击放置元件到CPU区域,单击右键在快捷菜单中选择Done。

(5)选择File→Save,单击Yes按钮保存设置。

5.进入PCB编辑器约束

约束即用户定义的附加到网络或者引脚对上的要求,电子约束管理着网络和引脚对的行为。可以使用约束管理器来提取和管理电子约束。

(1)选择Setup→Constraints→Electrical。

(2)打开约束管理器,在右边框,选择Net→Routing→Relative Propagation Delay,如图6-2-13所示。

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图6-2-12 设置Selection filters

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图6-2-13 约束管理器

6.显示临界网络(Critical Nets)

(1)在PCB编辑器中,选择Display→Show Rats→Net。

(2)在约束管理器中,在VD总线上单击右键,从快捷菜单中选择Select指令,如图6-2-14所示。

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图6-2-14 菜单栏

(3)观察PCB编辑器窗口,VD总线被显示。框选差分对对象,单击右键从快捷菜单中选择Select,如图6-2-15所示。

(4)单击右键从快捷菜单中选择Select,并选择对照组,如图6-2-16所示。

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图6-2-15 菜单栏

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图6-2-16 菜单栏

(5)在PCB编辑器中,单击右键从快捷菜单中选择Done。

7.运行DRC

(1)选择Tools→Update DRC。

(2)DRC错误的数量被显示在PCB编辑器信息区域。如果有错误,将在设计中标记。

(3)修复之前要确定DRC的错误总数。

(4)选择View→Zoom Fit查看全图,选择File→Save并单击Yes按钮保存设置。