Cadence Concept-HDL & Allegro原理图与电路板设计(第2版)
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5.2 差分对(Differential Pairs)

1.创建差分对电气约束设置

(1)选择Electrical Constraint Set→Routing→Differential Pair工作表,如图5-2-1所示。

(2)选择右面的窗口,在root设计的object栏单击右键并从快捷菜单中选择Create→Electrical Cset,如图5-2-2所示。打开CreateElectricalCset对话框,将ElectricalCSet命名为diffpair,如图5-2-3所示。

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图5-2-1 选择工作表

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图5-2-2 菜单栏

(3)在Objects下多了DIFFPAIR一栏,如图5-2-4所示。

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图5-2-3 Create ElectricalCset对话框

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图5-2-4 设置Objects

2.定义差分对规则

(1)在Uncoupled Length下的Gather Control栏选择Include,如图5-2-5所示。

(2)在Uncoupled Length Max区域输入600,即非耦合长度最多是 600mils。Uncoupled Length的这个值限制差分对的一对网络之间不匹配的长度。如果将gather control设置为ignore,则实际非耦合长度包括两个gather point之间的耦合带之外的长度,当超过Max 值时,就会产生冲突。

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图5-2-5 设置Uncoupled Length栏

(3)在Static Phase Tolerance区域输入200。Static Phase Tolerance 约束确保差分对成员在转换时是同向和同步的,单位是时间ns或者长度mil。Actual 值反映的是差分对成员之间时间或者长度的差值,当差值超出tolerance值时,就会有冲突。

(4)在Primary Gap区域输入6,在Primary Width区域输入7。

img Primary Gap设置的是差分对之间边到边的理想间距。(+/-)tolerance值是允许的偏差值,如果间距偏差在许可范围内,差分对被认为是耦合的。

img Primary Width设置的是差分对成员的理想宽度。

(5)在(+)Tolerance和(-)Tolerance区域都输入0.1,设置如图5-2-6所示。

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图5-2-6 设置对象DIFFPAIR

(6)在Constraint Manager窗口,选择File→Save,保存设置。

3.定义差分对信号

(1)单击Net→Routing→Differential Pair工作表,如图5-2-7所示。

(2)在Objects栏,选择网络FPGA和HS,如图5-2-8所示。

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图5-2-7 选择工作表

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图5-2-8 选择网络

(3)选择Objects→Create→Differential Pair,打开Create Differential Pair窗口,如图5-2-9所示。Diff Pair Name区域默认为DP1,选择FPGA和HS网络,单击Create和Close按钮。

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图5-2-9 Create Differential Pair窗口

(4)Objects一栏显示为DP1,网络列表如图5-2-10所示,Type一栏显示为DPr(差分对)。

(5)选择BRD和BWR,重复上述步骤设置名为DP2的差分对,如图5-2-11所示。

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图5-2-10 网络列表

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图5-2-11 选择BRD和BWR

(6)选择BRESET和SEL并创建名为DP3的差分对,如图5-2-12所示。

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图5-2-12 创建DP3

(7)在Constraint Manager窗口,选择File→Save,保存设置。

4.为差分对设置电气约束

(1)在Objects栏,选择3个差分对对象,如图5-2-13所示。

(2)选择Objects→Constraint Set References,打开Electrical CSet References对话框,在下拉列表中选择DIFFPAIR并单击OK按钮,如图5-2-14所示。

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图5-2-13 选择3个差分对对象

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图5-2-14 Electrical CSet References对话框

(3)在Electrical CSet Apply Information窗口单击Close按钮,Referenced Electrical Cset一栏显示了3个DIFFPAIR,如图5-2-15所示。

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图5-2-15 查看这3个差分对

(4)在约束管理器中,选择File→Save,保存设置。